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Verilog数字系统设计教程(第3版)
定    价: ¥45.00
关 注 度: 0 库存状态: 未知 图书状态: 销售中
 
作    者: 夏宇闻
出版时间: 2013-11      
版    次: 1 印    次: 1 字    数: 787千字
开    本: 787×1092 1/16
纸    张: 1 ISBN: 978-7-5124-1186-9
 详细信息
 作者简介
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 图书简介

本书讲述利用硬件描述语言(Verilog HDL)设计复杂数字系统的方法。这种方法源自20世纪90年代的美国,取得成效后迅速在其他先进工业国得到推广和普及。利用硬件描述语言建模、通过仿真和综合技术设计出极其复杂的数字系统是这种技术的最大优势

本书从算法和计算的基本概念出发,讲述如何用硬线逻辑电路实现复杂数字逻辑系统的方法。全书共分三部分。第一部分内容共18章;第二部分共12个上机练习实验范例;第三部分是Verilog硬件描述语言参考手册,可供读者学习、查询之用。本书第2版后,在语法篇中增加了IEEE Verilogl3642001标准简介,以反映Verilog语法的最新变化。

本书的讲授方式以每2学时讲授一章为宜,每次课后需要花10h复习思考。完成10章学习后,就可以开始做上机练习,由简单到复杂,由典型到一般,循序渐进地学习Verilog HDL基础知识。按照书上的步骤,可以使大学电子类及计算机工程类本科及研究生,以及相关领域的设计工程人员在半年内掌握Veri log HDL设计技术。

本书可作为电子工程类、自动控制类、计算机类的大学本科高年级及研究生教学用书,亦可供其他工程人员自学与参考。

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